發(fā)布：2023-04-24 09:34:39 關(guān)注：44781次
浙江大學(xué)計算機科學(xué)與技術(shù)學(xué)院唐華錦教授課題組擬公開招聘FPGA神經(jīng)網(wǎng)絡(luò)算法方向博士后1名。唐華錦，浙江大學(xué)求是特聘教授、博導(dǎo)，國家高層次人才, IEEE TCDS期刊主編，課題組依托浙江大學(xué)計算機科學(xué)與技術(shù)學(xué)院和腦機智能全國重點實驗室，主要從事類腦計算、神經(jīng)形態(tài)計算與芯片、智能機器人等方向的研究工作。招聘將堅持公開、公平、競爭、擇優(yōu)的原則，凡符合招聘崗位要求且有意向者，請將個人簡歷及其它能證明本人能力、水平的相關(guān)材料發(fā)至郵箱：jrshen@zju.edu.cn，并在標(biāo)題欄中注明“應(yīng)聘+申請人姓名”，面試后擇優(yōu)錄用。實驗室介紹：https://person.zju.edu.cn/htang。
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工作地點：浙江大學(xué)計算機學(xué)院及腦機智能全國重點實驗室
崗位待遇：錄用人員待遇具體面議，按照學(xué)校規(guī)定從優(yōu)確定。
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崗位要求
1. 具有計算機類、電子信息類相關(guān)專業(yè)博士學(xué)位或即將取得學(xué)位；
2. 主要開展神經(jīng)網(wǎng)絡(luò)模型和基于FPGA的算法設(shè)計等研發(fā)等工作
3. 精通常用神經(jīng)網(wǎng)絡(luò)模型架構(gòu)，有基于FPGA的神經(jīng)網(wǎng)絡(luò)加速器或嵌入式系統(tǒng)設(shè)計經(jīng)驗；
4. 熟悉Verilog、VHDL等硬件編程語言，熟練使用Vivado、Vitis等開發(fā)工具；
5. 具有類腦計算模型和學(xué)習(xí)算法經(jīng)驗優(yōu)先；
6. 協(xié)助團隊設(shè)計并實現(xiàn)硬件適配的類腦計算架構(gòu)和學(xué)習(xí)算法。
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