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職責(zé)描述： 負(fù)責(zé)設(shè)計(jì)自研芯片配套的模擬IP，最終支持自研芯片平臺(tái)或解決方案的產(chǎn)品化。 工作職責(zé)： 1. 參與模擬IP需求分析，架構(gòu)選型和規(guī)格的制定； 2. 根據(jù)規(guī)格和技術(shù)規(guī)范，設(shè)計(jì)實(shí)現(xiàn)具體電路架構(gòu)； 3. 規(guī)劃版圖布局，指導(dǎo)layout工程師完成符合電路性能要求的模擬版圖，以及后仿； 4. 協(xié)助測(cè)試工程師完成測(cè)試、debug和量產(chǎn)支持； 5. 支持模擬IP的應(yīng)用方案設(shè)計(jì)和調(diào)試； 任職要求： 1. 碩士研究生及以上，微電子相關(guān)專業(yè)； 2. 有電源管理模塊，時(shí)鐘模塊，或者接口ip等電路設(shè)計(jì)經(jīng)驗(yàn)； 3. 熟悉 CMOS 工藝和模擬版圖設(shè)計(jì)要求，能夠指導(dǎo)版圖設(shè)計(jì)； 4. 熟悉模擬設(shè)計(jì)開發(fā)環(huán)境，熟練掌握常用EDA軟件和仿真方法； 5、具備較好的溝通、學(xué)習(xí)能力，具有團(tuán)隊(duì)合作精神；